LEONRV 🤖
@VenFPGA
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publicando los avances de mi proyecto con FPGA
Joined April 2023
@splinedrive I've made a great living over the past 40+ years being the hardware guy that understands software and/or the software guy that understands hardware - people in this biz tend to be terribly siloed doing one or the other, being able to do both is a great skill
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It's Showtime!! My work it's completed! A Humble Computer with an RISC-V 5-stage softcore in the icefun board. It was hard to write here some updates. I hope, now with time, I can show you more of my work
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On FPGAFriday.... I found an error on this bulky expression, (an OR multiplexer) For some reason, when I activated M_lsbytrcsr[0] or [12] I always got zero instead of a nonzero value. With other bits, I got the correct value. What does two have in common? What did I do wrong?
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Necesito un mejor nombre para mi computadora. RVLEON no me está gustando ya. ¿Cómo le pongo un nombre más apropiado?
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Me sorprende como he avanzado y madurado con esta última parte de mi proyecto. Y la ayuda que obtuve de lo que conseguí de internet... Uff Mucho dolor de cabeza pero ya finalizando el mayor reto de mi carrera
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Actualmente, no entiendo lo que hice ahí. Pero estuve probando el depurador y el dtm y he corregido errores con esto. Lo bueno es que el dtm es sencillo y tan simple como mandar 0x04 para leer el registro Data0 y 0x84 para escribirlo (y otros 6 registros del depurador)
Puedo decir que tengo un depurador de hardware, más simple a como la especificación indica, pero puedo saber los valores de los registros del cpu de buena mano El dtm no trabaja con JTAG(no tengo tiempo de entenderlo) pero me ha encantado como me ha quedado con tx/rx y es fiable
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Puedo decir que tengo un depurador de hardware, más simple a como la especificación indica, pero puedo saber los valores de los registros del cpu de buena mano El dtm no trabaja con JTAG(no tengo tiempo de entenderlo) pero me ha encantado como me ha quedado con tx/rx y es fiable
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rn I'm Implementing a Debugger (DM+DTM) for my own RISCV softcore. I try to follow the debugger specifications but I'm out of time so I just oversimplificate a lot of that specification
Why if it isn’t #FPGAFriday! Are you doing anything nice? I’m getting back to bitmap graphics in Verilog. I have no exciting captures to share this week, just a video ram module.
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Resulta que LEON es el nombre de un procesador conocido (y lo descubrí por unos antecedentes de mi tesis) Ya no quiero ponerle RVLEON, al computador, ni rv32nexpo a mi procesador. Necesito nombres nuevos, YA Y no se que nombre ponerle a un procesador 😭 y menos al computador
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Y ahora, un control del estado del procesador. En mi caso sería solo el modo depurador, porque no implementé un modo usuario o supervisor, sino el sencillo... quizás por ello me costó verlo
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Eso hizo darme cuenta que el procesador tiene diferentes "niveles" de control Uno dado por las instrucciones en ejecución para ajustar el camino de los datos a la ópera correcta. Otra el flujo entre segmentos, que hace invalidar o detener instrucciones en una etapa en particular
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Lo que me pareció necesario incluir es el modo un paso a la vez, para que se moviera un ciclo las instrucciones dentro del pipelining El pequeño diagrama a la izquierda más o menos indica eso
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El depurador es muy simple, pero por esa simpleza debía agregar un bus depurador por separado. Los CSR relacionados al depurador ni siquiera los escribe el cpu, sino el DM (módulo depurador que haré), porque... El procesador no ejecutará código por el depurador xd
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Realmente creo que esta parte es la que más me ha costado. Aunque parezca sencilla, rompe los esquemas que tenía del procesador. Por suerte, cuando implemente la caché ya tenía asegurada algunas cosas como el estancamiento total del procesador
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Actualmente estoy implementando un modo depurador para mi procesador RISCV. Está es la última etapa de mi proyecto, y me siento feliz
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"a + b", this one line of Python code executes thousands of lines of C behind the scenes. My latest article explains what goes on in the CPython runtime to execute this seemingly simple operation. You will learn about: - Dynamic dispatch implementation in CPython - What is the
The next article in the CPython internals series is ready (pending edits). It stands at 1800 words & 13 annotated code listings. All that just to explain, what goes on when you run `a + b` in Python. Coming soon to the subscribers of Confessions of a code Addict (link in bio).
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Estoy realmente encantado. Mi propio módulo de computación... Mi propio procesador y puedo ponerle todo programa posible... BUFF Falta poco, y aquí poco he comentado... Pero genial va todo
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Hoy utilice el módulo usbhid hecho por @nand2mario para hacer un pequeño pizarrón a través de mi módulo VGA. Tiene un procesador riscv segmentado que hice, como objetivo de mi tesis. Así que, aquí ven un software con el módulo VGA y el módulo HID para mie procesador
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Literally one hour to route my project.... And there's no ending here
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